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25AA02E48
BLOCK DIAGRAM
STATUS
Register
HV Generator
I/O Control
Logic
Memory
Control
Logic
X
Dec
EEPROM
Array
Page Latches
SI
SO
CS
SCK
HOLD
WP
TABLE 2-1:
Y Decoder
Sense Amp.
R/W Control
V CC
V SS
INSTRUCTION SET
Instruction Name
READ
WRITE
WRDI
WREN
RDSR
WRSR
x = don’t care
FIGURE 2-1:
CS
Instruction Format
0000 x011
0000 x010
0000 x100
0000 x110
0000 x101
0000 x001
READ SEQUENCE
Description
Read data from memory array beginning at selected address
Write data to memory array beginning at selected address
Reset the write enable latch (disable write operations)
Set the write enable latch (enable write operations)
Read STATUS register
Write STATUS register
0
1
2
3
4
5
6
7
8
9 10 1 1 12 13 1 4 1 5 1 6 17 1 8 1 9 2 0 2 1 22 2 3
SCK
Instruction
Address Byte
SI
0
0
0
0
0
0
1
1 A 7 A 6 A 5 A 4 A 3 A 2 A 1 A 0
High-Impedance
Data Out
SO
7
6
5
4
3
2
1
0
? 2010 Microchip Technology Inc.
DS22123B-page 7
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